第08版:集成电路
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5G极化码与Speedcore eFPGA集成支持客户5G方案快速上市
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编辑:顾鸿儒
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3上一篇  下一篇4 2018年3月30日 放大 缩小 默认        

5G极化码与Speedcore eFPGA集成支持客户5G方案快速上市

 

本报讯 基于现场可编程门阵列(FPGA)的硬件加速器器件和嵌入式FPGA(eFPGA)领域内的领导性企业Achronix半导体公司日前宣布:与专注于下一代无线通信加速的半导体知识产权(IP)企业AccelerComm有限公司达成合作。AccelerComm专利申请中的极化码(Polar Code)已经被移植到Achronix的FPGA产品组合中,从而支持客户实现更快速的上市产品,并为使用New Radio新无线的5G增强移动宽带(eMBB)技术方案提供客制化服务。AccelerComm的IP已经被集成到ACE设计工具中,以用于Achronix的SpeedcoreTM嵌入式FPGA(eFPGA)技术。

AccelerComm的极化码解决方案基于一种独特的存储架构,可在正确的时间将正确的信息传送给正确的处理单元,从而改善硬件效率、功率效率和延迟性。随着这款IP适用于AchronixSpeedcore eFPGA阵列结构,可实现比其它可选的、基于软件的方法更低的功耗和更高的吞吐量。在搭载了eFPGA的特定用途集成电路(ASIC)或系统级芯片(SoC)中实例化极化码IP,可使集成化解决方案具有最小的通信延迟和最低的功耗。

 
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